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Discussion: Intel Quad Pumped Bus

  1. #1
    Salut

    Intel utilise sur ses CPU un Front Side Bus théoriquement plus rapide que AMD grâce à la technologie "Quad Pumped Bus".
    Si de nombreux documents précisent qu'en un cycle d'horloge 4 tranferts sont réalisés, soit un mode 4x, soit pour 100MHz, 400M Transfert par secondes, aucun ( Moi, je n'ai pas trouvé ) n'explique la technologie de transmission qui permet ce débit.
    Même les sites Intel sont très imprécis car cette technologie, Intel l'a achetée chez SIS :D

    Si un spécialiste peut m'éclairer :help:

    Merci

  2. #2
    Et AMD qui a un bus DDR à 200Mhz, c'est vrai que c'est plus lent ...

  3. #3
    Citation Envoyé par Lissyx
    Et AMD qui a un bus DDR à 200Mhz, c'est vrai que c'est plus lent ...
    Le FSB d'AMD a évolué depuis l'Athlon XP 3200+. Aujourd'hui c'est 1 GHz DDR sur 16 bits dans les deux sens.
    "si tout le monde s'etait dit "pour quoi faire ?" je pense qu'on tournerait encore sur 8086. Si tant est qu'on ait l'electricite ... " Franck@X86
    If all goes well will Dell sell Cells?
    <°)))><

  4. #4
    Citation Envoyé par jihef
    Le FSB d'AMD a évolué depuis l'Athlon XP 3200+. Aujourd'hui c'est 1 GHz DDR sur 16 bits dans les deux sens.
    En plus, j'avais oublié ça aussi.

  5. #5
    Sur les k7 d'amd, c'est pas du quad pumped?

  6. #6
    Intel page4
    le bus à l'air d'utiliser une horloge doulbe en ddr (ce qui fait 4X au final)

  7. #7
    Citation Envoyé par Fanche
    Sur les k7 d'amd, c'est pas du quad pumped?
    Non, c'est ce que j'expliquait, que c'est un bus DDR.

    Mais vu que les core K7 consomment pas de la bande passante comme feu les P4 ...

  8. #8
    Vi c'est vrai k7 c'était encore DDR

  9. #9
    Citation Envoyé par Fanche
    Vi c'est vrai k7 c'était encore DDR
    Et ça l'est toujours.
    "si tout le monde s'etait dit "pour quoi faire ?" je pense qu'on tournerait encore sur 8086. Si tant est qu'on ait l'electricite ... " Franck@X86
    If all goes well will Dell sell Cells?
    <°)))><

  10. #10

  11. #11
    Il me semble que l'archi K7 était limitée à 266 MHz par un bus EV6 : ou alors ce sont les chipsets Via KT266/333/400/600 qui étaient limités par ce bus. Faudrait que je retrouve la discussion dans le forum.

    Edit : ce sont les chipsets Via et SiS qui sont limités par l'EV6

  12. #12
    Citation Envoyé par childerik
    Il me semble que l'archi K7 était limitée à 266 MHz par un bus EVO : ou alors ce sont les chipsets Via KT266/333/400/600 qui étaient limités par ce bus. Faudrait que je retrouve la discussion dans le forum.
    Mon XP 2500+ tournait à 166*11. Le seul XP qui avait un FSB à 200 était le 3200+ en 200*11.
    "si tout le monde s'etait dit "pour quoi faire ?" je pense qu'on tournerait encore sur 8086. Si tant est qu'on ait l'electricite ... " Franck@X86
    If all goes well will Dell sell Cells?
    <°)))><

  13. #13
    Y'a eu un 3000+ en FSB200 aussi, et peut-être d'autres (je suis sur du 3000+ en tout cas).
    Et bien évidemment quantité en FSB166 (de l'automne 2002 a l'Athlon 64, les 3200+ et 3000+ FSB200 datant de début 2003).

  14. #14
    y'a eu un 3100+ aussi je crois (200*10.5)
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  15. #15
    Citation Envoyé par jihef
    Le FSB d'AMD a évolué depuis l'Athlon XP 3200+. Aujourd'hui c'est 1 GHz DDR sur 16 bits dans les deux sens.
    Pour être plus précis il n'y a plus de FSB sur le K8.
    Il y a le bus HTT à 1Ghz/16bits d'une part, et le bus mémoire cadencé à la même vitesse que la RAM, en 64bits, dual channel sur les s939 et AM2, donc l'équivalent du QDR intel (deux bus DDR=QDR soit 6,4 Go/s à 200Mhz).

    Sauf que le bus mémoire AMD ne s'occupe que de la RAM, là où le QDR Intel reste un classique FSB.

  16. #16
    Moi je considère que le lien HT est le FSB. Ca veut dire Front Side Bus donc le bus que le cpu présente au reste du systeme. Donc moi ca ne me dérange pas de dire FSB.
    "si tout le monde s'etait dit "pour quoi faire ?" je pense qu'on tournerait encore sur 8086. Si tant est qu'on ait l'electricite ... " Franck@X86
    If all goes well will Dell sell Cells?
    <°)))><

  17. #17
    oui mais normalement le fsb est entre la partie processeur central et le contrôleur mémoire (carte graphique aussi depuis l'agp), c'est pourquoi on ne l'appelle plus ainsi sur les proc amd car il est en fait dans le proc. en fait il n'y a plus de northbridge.

  18. #18
    La seule raison pour ne plus l'appeler FSB a mon avis est que ce n'est plus un bus mais un lien point a point.
    Apres on peut discuter pour savoir si front side s'applique encore, et a priori ce lien reste le moyen de communiquer du CPU avec le reste du monde donc pourquoi pas.
    fefe - Dillon Y'Bon

  19. #19
    En tout cas çà n'est pas clair du tout pour celui qui a posé la question.

    Le système E/S du K8 est largement supérieur au bus QDR, même si çà n'est pas tellement sensible en monocpu en terme de performance. L'oc est par contre indépendant de la RAM sur K8, une fois assimilé le fonctionnement, ce qui est assez pratique.

  20. #20
    Personne n'a d'infos à propos de l'eventuel nouveau FSB du Bloomfield, destiné a remplacer le quad pumped du P4 ?

    http://www.hardware.fr/news/8644/soc...ield-2008.html

    Autre question, selon vous le controleur mémoire sera t il intégré au processeur ?

  21. #21
    Citation Envoyé par Marcel
    Personne n'a d'infos à propos de l'eventuel nouveau FSB du Bloomfield, destiné a remplacer le quad pumped du P4 ?

    http://www.hardware.fr/news/8644/soc...ield-2008.html

    Autre question, selon vous le controleur mémoire sera t il intégré au processeur ?
    Le bloomfield est en effet sensé étrenner le CSI=common systems interconnect, équivalent de l'Hypertransport.
    http://arstechnica.com/news.ars/post/20061219-8458.html

    Intel doit être le dernier à passer à ce type d'E/S (coût de fabrication...). Leur premier cpu à contrôleur intégré devrait être le redoutable Tao Paï Paï :
    http://forum.x86-secret.com/showthread.php?t=6137

  22. #22
    Tao Paï Paï, il est nul :D

    Même en revenant en Cyborg, il se fait battre par l'élève de son frère.

  23. #23

  24. #24
    Citation Envoyé par jose99m
    Le bloomfield est en effet sensé étrenner le CSI=common systems interconnect, équivalent de l'Hypertransport.
    http://arstechnica.com/news.ars/post/20061219-8458.html

    Intel doit être le dernier à passer à ce type d'E/S (coût de fabrication...). Leur premier cpu à contrôleur intégré devrait être le redoutable Tao Paï Paï :
    http://forum.x86-secret.com/showthread.php?t=6137
    Merci beaucoup
    Je vend un onduleur 4000VA !! (MGE UPS Pulsar EX40 ) ici : http://smpfr.mesdiscussions.net/smpf...jet_1587_1.htm

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